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基于CPLD的组合逻辑电路的设计

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  • 上传时间:2021-07-08
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  • 标      签: 组合逻辑电路 cpld

资 源 简 介

1、设计一个四舍五入判别电路,其输入为8421BCD码,要求当输入大于或等于5时,判别电路输出为1,反之为0。   2、设计四个开关控制一盏灯的逻辑电路,要求改变任意开关的状态能够引起灯亮灭状态的改变。(即任一开关的合断改变原来灯亮灭的状态)   3、设计一个优先排队电路,其框图如下:   排队顺序:   A=1 最高优先级   B=1 次高优先级   C=1 最低优先级   要求输出端最多只能有一端为“1”,即只能是优先级较高的输入端所对应的输出端为“1”。   实验连线   1、四位拨码开关连D3、D2、D1、D0信号对应的管脚。   OUT输出信号管脚接LED灯。   2、四位按键开关分别连K1、K2、K3、K4信号对应的管脚。   OUT输出信号管脚接LED灯。   3、A、B、C信号对应管脚分别连三个按键开关。输出A_Out、B_Out、C_Out信号对应的管脚分别连三个LED灯。   (具体管脚参数由底层管脚编辑决定)   参考原理图   1、①原理图,如图5-1所示:
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