资 源 简 介
结合Xilinx、Altera等公司的FPGA芯片，简要罗列一下FPGA内部的资源或专用模块，并简要说明这些资源的一些作用或用途。（至少列出5项，越多越好）1．可编程输入输出单元（IOB）外部输入信号可以通过IOB模块的存储单元输入到FPGA的内部，也可以直接输入FPGA内部。当外部输入信号经过IOB模块的存储单元输入到FPGA内部时，其保持时间（HoldTIme）的要求可以降低，通常默认为0。为了便于管理和适应多种电器FPGA的IOB被划分为若干个组（bank），每个bank的接口标准由其接口电压VCCO决定，一个bank只能有一种VCCO，但不同bank的VCCO可以不同。只有相同电气标准的端口才能连接在一起，VCCO电压相同是接口标准的基本条件。2．可配置逻辑块（CLB）CLB是FPGA（xilinx）内的基本逻辑单元，CLB的实际数量和特性会因为器件的不同而不同，但是每个CLB都包含一个可配置开关矩阵，此矩阵由4或6个输入、一些选型电路（MUX）和触发器组成。开关矩阵是高度灵活的，可以对其进行配置以组成组合逻辑、移位寄存器或RAM。在Xilinx公司的FPGA器件中，CLB有多个相同的Slice和附加逻辑组成，每个CLB模块不仅可以用于实现组合逻辑、时序逻辑，还可以配置为分布式RAM和分布式ROM。而在ALTERA公司的FPGA器件中LE（logicelements）是描述内部逻辑的基本单元，比如cycloneIV系列的LE由一个4输入LUT+FF构成。Slice是Xilinx公司定义的基本逻辑单位，一个Slice由两个4输入的函数发生器（LUT）、进位逻辑、算数逻辑、存储逻辑和函数复用器组成。而在ALTERA公司的FPGA器件中LE（logicelements）赛灵思LC是描述内部逻辑的基本单元，比如cycloneIV系列的LE由一个4输入LUT+FF构成。3．数字时钟管理模块（DCM）业内大多数FPGA均提供数字时钟管理（Xilinx的全部FPGA均具有这种特性）。Xilinx推出最先进的FPGA提供数字时钟管理和相位环路锁定。相位环锁定能够提供精确的时钟综合，且能够降低抖动，并实现过滤功能。4．嵌入式块RAM（BRAM）大多数FPGA都具有内嵌的块RAM，这大大拓展了FPGA的应用范围和灵活性。块RAM可被配置为单端口RAM、双端口RAM、内容地址存储器（CAM）以及FIFO等常用存储结构。可以根据需要改变其位宽和深度，但要满足两个原则：首先，修改后的容量（位宽深度）不能大于18k比特；其次，位宽最大不能超过36比特。当然，可以将多片块RAM级联起来形成更大的RAM，此时只受限于芯片内块RAM的数量，而不再受上面两条原则约束。FPGA芯片内有两种存储器资源：一种叫blockram，另一种是由LUT配置成的内部存储器（也就是分布式ram）。Blockram由一定数量固定大小的存储块构成的，使用BLOCKRAM资源不占用额外的逻辑资源，并且速度快。但是使用的时候消耗的BLOCKRAM资源是其块大小的整数倍。
