资 源 简 介
Verilog黄金参考指南是Verilog硬件描述语言及其语法语义合并以及将它应用到硬件设计的一个简明的快速参考指南Verilog黄金参考指南并不是要代替IEEE的标准Verilog语言参考手册它不像IEEE的标准手册提供了Verilog完整正式的描述相反黄金参考指南以一种方便的参考格式解答了在Verilog的实践应用过程中经常遇到的问题Verilog黄金参考指南也不想成为介绍性的指南这里所提出的信息是一种扼要的参考格式而不是学习像Verilog这种复杂的主题所必要的渐进和共鸣方式但必须承认的是已经熟悉计算机语言的人希望将这个参考指南作为Verilog的课本因此在开始本指南就会对这个主题进行一个简单的非正式介绍Verilog黄金参考指南的主要特征是它包含了从许多Verilog项目中积聚起来的大量实践知识指南不仅提供方便的语法参考很多类似的书也有还对最常见的语言错误提出警告在代码不能编译的时候给出线索指出要看什么地方警告你注意合并问题并对改善你的编码形式提出建议Verilog黄金参考指南是为了给Doulos的系列Verilog训练课程增值也是HDLPaceMakerDoulosVerilog计算机基础训练包的补充Verilog硬件描述语言HDL是描述电子电路行为和结构的一种语言是一种IEEE标准IEEEVerilog用于模拟从随机和纯行为到门级和开关级的抽象范围等层次的数字电子电路功能也用于从许多抽象寄存器传输级描述合并即自动产生门级描述Verilog一般用于支持高层次的设计或基于语言的设计其中电子设计在用自动合并工具进行详细设计前要通过高层次的完全抽象仿真来检验Verilog也广泛应用于IC的门级检验包括仿真故障仿真和定时检验Verilog最初是在1984年由GatewayDesignAutomaTIon公司开发Verilog-XL仿真器的时候一起开发出来1989年CadenceDesignSystems公司并购Gateway公司同时拥有对Verilog语言和Verilog-XL仿真器的权力1990年Cadence将Verilog语言不是Verilog-XL放到公共领域为了使Verilog语言通过IEEE标准化过程一个非赢利性组织OpenVerilogInternaTIonalOVI将它不断推进结果在1995年Verilog成为一个IEEE标准此后OVI仍继续不断维护和开发这种语言
