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在更高的抽象层次设计 ASIC IP

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  • 上传时间:2021-06-14
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  • 标      签: Mentor ASIC IP

资 源 简 介

在特定图像处理硬件设计中成功运用  High-Level  Synthesis  (HLS)  和  High-Level  Verification  (HLV)  数年之后,Qualcomm  认识到了  HLS/HLV  的优势,并希望探索在公司内部署该流程。要让  HLS/HLV  能成功予以采用,HLS  编码风格、代码检查、约束驱动型综合、设计构造以及  C++  和  SystemC  代码的结构和功能验证都需要标准化的企业设计流程。本白皮书将探讨这种全新的  HLS/HLV  流程能够为  Qualcomm  这类公司带来诸多优势的一些原因,概括说明该流程及其优点,并介绍其在不久的将来可如何提供更多有利功能。
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