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如何使用Cyclone器件中的PLL

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  • 上传时间:2021-12-17
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  • 标      签: 频率 pll fpga

资 源 简 介

介绍CycloneFPGA具有锁相环(PLL)和全局时钟网络,提供完整的时钟管理方案。CyclonePLL具有时钟倍频和分频、相位偏移、可编程占空比和外部时钟输出,进行系统级的时钟管理和偏移控制。Altera®Quartus®II软件无需任何外部器件,就可以启用CyclonePLL和相关功能。本文将介绍如何设计和使用CyclonePLL功能。PLL常用于同步内部器件时钟和外部时钟,使内部工作的时钟频率比外部时钟更高,时钟延迟和时钟偏移最小,减小或调整时钟到输出(TCO)和建立(TSU)时间。硬件结构每个CycloneFPGA包括具有多达两个PLL。表1为种型号CycloneFPGA内可用的PLL数量。
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