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使用FPGA调用RAM资源的详细说明

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  • 上传时间:2021-12-05
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  • 标      签: 变量 RAM fpga

资 源 简 介

FPGA可以调用分布式RAM和块RAM两种RAM,当我们编写verilog代码的时候如果合理的编写就可以使我们想要的RAM被综合成BRAM(BlockRAM)或者DRAM(DistributedRAM),其中BRAM是blockram,是存在FPGA中的大容量的RAM,DRAM是FPGA中有LUT(look-uptable查找表)组成的。当使用的容量较小会综合成DRAM,容量大的时候综合成BRAM。以Xilinx的开发平台为例,在定义数组变量的时候在前面加上一段原语,定义成如下类型,工具会综合成块RAM(*RAM_STYLE=“{AUTO|BLOCK|BLOCK_POWER1|BLOCK_POWER2}”*)reg[RAM_WIDTH-1:0]《ram_name》[(2**RAM_ADDR_BITS)-1:0];在定义数组变量的时候在前面加上一段原语,定义成如下类型,工具会综合成分布式RAM(*RAM_STYLE=“{AUTO|DISTRIBUTED|PIPE_DISTRIBUTED}”*)reg[RAM_WIDTH-1:0]《ram_name》[(2**RAM_ADDR_BITS)-1:0];如果没有这些语句工具会自动根据你定义的大小综合成块RAM或者分布式RAMXilinx的ISE平台的languagetemplates中都有这些的模板。详细介绍BRAM和DRAM的博客:https://blog.csdn.net/lizf477/arTIcle/details/49724465区别之1bram的输出需要时钟,dram在给出地址后既可输出数据。区别之2dram使用更灵活方便些区别之3bram有较大的存储空间,dram浪费LUT资源
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