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EDA技术之VerilogHDL语言

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  • 上传时间:2021-10-22
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  • 标      签: VerilogHDL EDA技术

资 源 简 介

嵌入式基于altera的课件 Verilog HDL门级结构描述 用于门级描述关键字包括:not(非门)、and(与门)、 nand(与非门)、or(或门)、nor(或非门)、xor(异或门)、xnor(异或非门)、buf(缓冲器)以及bufif1、bufif0、 noTIf1、noTIf0等各种三态门。门级描述语句格式为 《门类型》 [《驱动能力》 《延时》 ](门实例列表); nand #10 nd1(a,data,clock,clear); 使用了一个名为nd1的与非门,输入为data、clock 、clear 。输出为a,输出与输入的延时为10个时间单位
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