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AXI DMA测试-AXI总线最后一章

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  • 上传时间:2021-12-17
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  • 标      签: AXI-DMA AXI总线

资 源 简 介

本文转载自: OpenFPGA微信公众号AXIDMA测试增加一个AXIDMA章节,这部分内容是很多例程的基础,难度不大但是也不小,需要彻底理解整个运行机制。图4‑61测试框图处理器通过M_AXI_GP0接口和AXI_DMA通信,以设置、启动和监控数据传输。数据传输通过S_AXI_HP0接口。整个过程如下:lPS端ARM将数据发送给DDR。lPS控制DMA,使DMA通过数据通道读取DDR中的数据;DMA将读取到的数据传给FIFO。lFIFO将数据传输给DMA;PS控制DMA,使DMA通过数据通道将数据写入DDR中。l传输校验,对比接收数据与发送数据是否一致。详细的建立工程细节请参考例程下的《DOC》文件夹。BD框图:图4‑62BD框图SDK部分详见《DOC》文件夹下的《AXIDMALOOPSDK代码说明.docx》。详细代码见百度云链接:链接:https://pan.baidu.com/s/18hj_MzNwCo1QB6u9CA47ww提取码:open后期会整理好统一发到GitHub上。
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