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使用数字电路芯片实现的分秒计时器资料合集

资 源 简 介

一、实验目的:   设计一个有60进制和24进制计数功能,能通过译码器及七段数码管显示的时钟电路。   功能要求:   在连续脉冲的触发下,秒、分为60进制计数,时为24进制计数,并且要求有译码、显示。   二、设计步骤   1)使用的芯片2-5-10进制计数器(74LS90),画出管脚图、填写功能表。   2)设计出有24进制、60进制的计数、译码、显示的电路图(24进制、60进制的电路图)(译码显示模块请用4输入DCD-HEX数码管,仿真截图贴在下面)
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