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《Verilog的135个经典设计实例》

  • 资源大小: 226.93KB
  • 上传时间:2021-06-16
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  • 标      签: FPGA Verilog

资 源 简 介

《Verilog的135个经典设计实例》均出自王金明:《  Verilog  HDL  程序设计教程》,文中介绍了包括各种不同类型的加减法器,选择器,频率锁存等数字电路模块。
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