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本原代码中利用VHDL语言编写了RAM、FIFO、ROM等常用的存储和缓冲部件

  • 资源大小:3 K
  • 上传时间:2021-05-03
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  • 标      签: VHDL FIFO RAM ROM

资 源 简 介

本原代码中利用VHDL语言编写了RAM、FIFO、ROM等常用的存储和缓冲部件,完全的代码在ALTERA的FPGA上已经通过仿真测试,保证可用.
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