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FPGA视频教程之学习FPGA选择verilog还是vhdl详细资料说明

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  • 标      签: vhdl Verilog fpga

资 源 简 介

本文档的主要内容详细介绍的是FPGA视频教程之学习FPGA选择verilog还是vhdl详细资料说明   设计复杂数字系统的工具和手段两种硬件描述语言:Verilog 和VHDL   ●VHDL   比VerilogHDL早几年成为I EEE标准;语法/结构比较严格,因而编写出的模块风格比较清晰;比较适合由较多的设计人员合作完成的特大型项目(一百万门以上)。   ●Verilog HDL   较多的第三方工具的支持语法结构比VHDL简单学习起来比VHDL容易仿真工具比较好使测试激励模块容易编写
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